Questões de Concurso
Sobre conceitos básicos em arquitetura de computadores em arquitetura de computadores
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A seguir, são apresentadas quatro etapas do ciclo de execução de uma instrução:
I. A busca do código de operação na memória principal, localizado no endereço indicado pelo Ciclo de Instrução, e seu armazenamento no Registrador de Instrução.
II. A Unidade de Controle comanda a execução da instrução e, se necessário, processa os dados disponíveis nos registradores.
III. Caso a instrução exija, a Unidade de Controle busca o(s) dado(s) na memória e os armazena nos registradores. Esta fase se repete até que todos os dados necessários à execução sejam transferidos.
IV. O Decodificador de Instrução decodifica o código de operação contido no Registrador de Instrução.
A sequência correta dessas etapas, desde o início até a execução da instrução, é
A seguir, são apresentadas quatro etapas do ciclo de execução de uma instrução.
I. A busca do código de operação na memória principal, localizado no endereço indicado pelo Ciclo de Instrução, e seu armazenamento no Registrador de Instrução.
II. A Unidade de Controle comanda a execução da instrução e, se necessário, processa os dados disponíveis nos registradores.
III. Caso a instrução exija, a Unidade de Controle busca o(s) dado(s) na memória e os armazena nos registradores. Esta fase se repete até que todos os dados necessários à execução sejam transferidos.
IV. O Decodificador de Instrução decodifica o código de operação contido no Registrador de Instrução.
A sequência correta dessas etapas, desde o início até a execução da instrução, é dada por
Assinale a opção que descreve o papel desempenhado pelo ENIAC, compreendendo sua importância histórica na trajetória da organização de computadores.
I. Nas CPUs, o conceito de pipelining promove o paralelismo no nível de processador.
II. O objetivo fundamental da memória cache é reduzir a latência computacional na tarefa de acesso aos dados.
III. Em uma memória primária, todas as células contêm o mesmo número de bits. Se uma célula consistir em k bits, ela pode conter quaisquer das 2k diferentes combinações de bits.
Analise as sentenças a seguir sobre a arquitetura e organização de computadores.
I) Praticamente todos os computadores oferecem um mecanismo por meio do qual outros módulos (E/S, memória) podem interromper o processamento normal do processador.
Porque:
II) As interrupções são fomecidas como um modo de melhorar a eficiência do processamento.
A partir das sentenças, conclui-se que:
Assinale a opção que indica a principal função das ferramentas de monitoramento de filas de processamento em um ambiente de Computação de Alto Desempenho (HPC).
Desenvolvida inicialmente nos anos 1960, a tabela ASCII atribui um código único de 7 bits para cada caractere alfanumérico, de pontuação, símbolos especiais e comandos de controle. O caractere “~” (til), no código ASCII padrão, possui o código 126 na base decimal.
Assinale a opção que indica sua representação na base octal.
Quanto às ferramentas de monitoramento de desempenho, à análise e otimização de recursos de hardware e software e à identificação e resolução de gargalos de desempenho, julgue o item.
Para otimizar os recursos de hardware dos servidores,
o profissional de TI deve aumentar aleatoriamente
a capacidade de hardware, sem análise prévia de
desempenho, já que quanto mais hardware melhor
para a instituição.
Quanto às ferramentas de monitoramento de desempenho, à análise e otimização de recursos de hardware e software e à identificação e resolução de gargalos de desempenho, julgue o item.
Uma das formas de otimizar tantos os recursos de
hardware quanto os de software é manter todos os
aplicativos abertos simultaneamente, para que seja
facilitado o acesso rápido.
I. No método big-endian, o endereçamento inicia pelo byte menos significativo.
II. O acesso aos bytes de palavras armazenadas na memória independe do método de ligação (big-endian ou little-endian) para processadores de menos de 32 bits.
III. Em ambos os métodos de ligação (big-endian e little-endian), os bits menos significativos do barramento de dados estão ligados aos bits menos significativos da palavra armazenada na memória.
Está correto o que se afirma em