Questões de Concurso Comentadas sobre arquitetura de computadores
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Enterprise Service Bus é um barramento para integração de serviços coletivos de bancos de dados distribuídos sobre arquitetura IP (internet protocol) para independência de camada de serviços.
A instrução TSL (test and set lock), presente em computadores projetados com múltiplos processadores, controla o conteúdo da palavra de memória em um registrador, permitindo que outro processador acesse a palavra de memória do registrador.
Com as tecnologias atuais, para uma máquina cujas instruções e cujos dados ocupem a mesma memória, é possível projetar um processador em que o contador de instrução (CI) e o registrador de endereço da memória (REM) tenham tamanhos diferentes em bits.
Um computador com memória principal capaz de armazenar palavras de 16 bits em cada uma de suas N células e com barramento de endereço que tenha 14 bits de tamanho terá uma capacidade total de armazenamento da memória principal de 8.192 bytes.