Questões de Arquitetura de Computadores para Concurso - Página 15

Q2520854

Ano: 2024 Banca: FGV Órgão: INPE Prova: FGV - 2024 - INPE - Tecnologista Júnior I - Ambiente de Supercomputação e HPC (High-Performance Computing) |

Q2520854 Arquitetura de Computadores

Em computação paralela os loops paralelos são muito úteis, permitindo que várias iterações de um loop sejam executadas simultaneamente por diferentes threads, aproveitando assim ao máximo os recursos de processamento disponíveis em sistemas paralelos. Isso é especialmente importante para acelerar o processamento de tarefas computacionais intensivas, dividindo o trabalho entre múltiplos núcleos de processamento.
Neste contexto, assinale a opção que apresenta o argumento utilizado no padrão OpenMP para combinar múltiplos loops em um único, permitindo sua execução em paralelo.

A

reduction(op:var).

B

collapse(n).

C

nowait.

D

final.

E

critical.

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Q2520853

Ano: 2024 Banca: FGV Órgão: INPE Prova: FGV - 2024 - INPE - Tecnologista Júnior I - Ambiente de Supercomputação e HPC (High-Performance Computing) |

Q2520853 Arquitetura de Computadores

Texto associado

Atenção: o enunciado a seguir refere-se à próxima questão.

OpenMP é um ambiente de programação paralela adequado para escrever programas paralelos a serem executados em sistemas de memória compartilhada. É uma coleção de interfaces de programação de aplicativos que inclui diretivas de compilador, funções de suporte e variáveis de ambiente, permitindo que os programadores explorem e controlem o paralelismo durante a execução de um programa.

Com isto em mente, a cláusula que especifica o número de threads que devem ser executadas em um bloco estruturado em paralelo é

A

omp_get_thread_num().

B

collapse(n).

C

omp_get_num_threads().

D

reduction(operator:variable).

E

num_threads.

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Q2520852

Ano: 2024 Banca: FGV Órgão: INPE Prova: FGV - 2024 - INPE - Tecnologista Júnior I - Ambiente de Supercomputação e HPC (High-Performance Computing) |

Q2520852 Arquitetura de Computadores

Texto associado

Atenção: o enunciado a seguir refere-se à próxima questão.

OpenMP é um ambiente de programação paralela adequado para escrever programas paralelos a serem executados em sistemas de memória compartilhada. É uma coleção de interfaces de programação de aplicativos que inclui diretivas de compilador, funções de suporte e variáveis de ambiente, permitindo que os programadores explorem e controlem o paralelismo durante a execução de um programa.

No contexto das variáveis utilizadas em programação paralela com OpenMP, analise as afirmativas a seguir e assinale (V) para a verdadeira e (F) para a falsa.

( ) A cláusula shared(list) especifica que cada variável da lista é compartilhada por todas threads do time, isso é, todas as threads compartilham uma mesma cópia da variável.
( ) Por padrão, variáveis declaradas antes de um bloco paralelo são compartilhadas.
( ) A cláusula private(list) especifica que cada variável da lista é privada por todas threads do time, isso é, cada thread tem sua própria cópia da variável.
( ) Por padrão, variáveis declaradas dentro de um bloco paralelo são privadas.

As afirmativas são, respectivamente,

A

V – V – V – V.

B

F – V – F – V.

C

V – F – V – F.

D

V – V – F – V.

E

F – F – F – F.

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Q2520697

Ano: 2024 Banca: VUNESP Órgão: Prefeitura de Santo André - SP Prova: VUNESP - 2024 - Prefeitura de Santo André - SP - Técnico de Informática |

Q2520697 Arquitetura de Computadores

Sobre monitoramento digital de imagens, na gravação ____________ as imagens são capturadas e armazenadas a partir do momento em que uma atividade específica acontece. Neste caso, o servidor é poupado em termos de recursos de armazenamento, já que a quantidade de dados armazenados é reduzida, quando comparada à gravação ______________ , em que as imagens são capturadas e armazenadas no servidor a todo momento, exigindo, assim, uma capacidade maior de armazenamento dos dados.
Assinale a alternativa que preenche, correta e respectivamente, as lacunas do texto.

A

contínua ... por detecção de movimento

B

por variação de temperatura ... por detecção de movimento

C

por eventos ... contínua

D

VGA ... HD

E

em nuvem ... em servidor local

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Q2520688

Ano: 2024 Banca: VUNESP Órgão: Prefeitura de Santo André - SP Prova: VUNESP - 2024 - Prefeitura de Santo André - SP - Técnico de Informática |

Q2520688 Arquitetura de Computadores

Considere os seguintes cenários de conexão de um pen drive em uma porta USB de um computador.

Imagem associada para resolução da questão

Assinale a alternativa que indica o cenário com a taxa de transmissão de dados mais rápida, considerando apenas as especificações técnicas do padrão USB.

A

Cenário 1

B

Cenário 2

C

Cenário 3

D

Cenário 4

E

Cenário 5

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Q2520687

Ano: 2024 Banca: VUNESP Órgão: Prefeitura de Santo André - SP Prova: VUNESP - 2024 - Prefeitura de Santo André - SP - Técnico de Informática |

Q2520687 Arquitetura de Computadores

Sobre memórias de microcomputadores, a(o) __________ encontra-se no primeiro conjunto de comandos executados ao ligar um computador, e está armazenado na memória _________ .

Assinale a alternativa que preenche, correta e respectivamente, as lacunas do texto.

A

BIOS … ROM

B

BOOT … RAM

C

BIOS … Cache

D

BOOT … Cache

E

BIOS … RAM

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Q2519127

Ano: 2024 Banca: FGV Órgão: INPE Prova: FGV - 2024 - INPE - Tecnologista Pleno I - Processamento de Alto Desempenho – PAD (HPC) |

Q2519127 Arquitetura de Computadores

Considerando a taxonomia criada por Michael Flynn para classificar arquiteturas de computação paralela, a categoria em que uma instrução é executada por múltiplos processadores usando diferentes fluxos de dados, é a

A

SISD.

B

SIMD.

C

SIPD.

D

MIMD.

E

MISD.

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Q2519126

Ano: 2024 Banca: FGV Órgão: INPE Prova: FGV - 2024 - INPE - Tecnologista Pleno I - Processamento de Alto Desempenho – PAD (HPC) |

Q2519126 Arquitetura de Computadores

Assinale a opção que indica a arquitetura que possibilita ao processador executar mais de uma instrução por ciclo de máquina.

A

Vetorial.

B

Escalar.

C

Superescalar.

D

Pipeline.

E

Superpipeline.

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Q2519123

Ano: 2024 Banca: FGV Órgão: INPE Prova: FGV - 2024 - INPE - Tecnologista Pleno I - Processamento de Alto Desempenho – PAD (HPC) |

Q2519123 Arquitetura de Computadores

Acerca dos componentes básicos de uma arquitetura de computador, analise as afirmativas a seguir.

I. O processador é composto por uma unidade de controle e uma unidade de dados.
II. A memória RAM (Random Access Memory) pode ser acessada para operações de escrita.
III. Equipamentos periféricos, como impressoras e monitores, não compõem a arquitetura do computador.

Está correto o que se afirma em

A

I, apenas.

B

II, apenas.

C

III, apenas.

D

I e II, apenas.

E

II e III, apenas.

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Q2518111

Ano: 2024 Banca: FGV Órgão: CVM Prova: FGV - 2024 - CVM - Analista CVM - Perfil 8 - TI / Sistemas e Desenvolvimento - Tarde |

Q2518111 Arquitetura de Computadores

Durante a análise de um sistema computacional avançado, o analista Clementino identifica uma falha crítica de desempenho que pode ser atribuída à arquitetura do computador. Ele observa que a falha está relacionada à forma como os diferentes componentes do sistema interagem entre si, afetando diretamente a eficiência do processamento de dados.

Com base nos seus conhecimentos sobre a organização e funcionamento dos componentes principais de um computador, sistemas de memória, sistemas de armazenamento e periféricos de entrada e saída, é correto afirmar que a causa raiz do problema identificado por Clementino é o(a):

A

aumento da frequência do processador além do suportado pela placa-mãe, causando superaquecimento e falhas esporádicas no sistema;

B

incompatibilidade entre o tipo de memória RAM utilizada e a velocidade máxima suportada pelo controlador de memória do processador, resultando em gargalos de desempenho;

C

uso, no SSD, de um sistema de arquivos ineficiente, que não está otimizado para as operações de leitura e escrita aleatórias, reduzindo a velocidade geral do sistema;

D

falha na configuração do DMA (Direct Memory Access) para os periféricos de entrada e saída, causando um uso excessivo da CPU para operações de E/S, o que diminui a eficiência do processamento de dados;

E

implementação de um algoritmo de criptografia muito complexo que exige capacidade computacional além do que o hardware atual pode fornecer, resultando em atrasos significativos no processamento de dados.

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Q2518110

Ano: 2024 Banca: FGV Órgão: CVM Prova: FGV - 2024 - CVM - Analista CVM - Perfil 8 - TI / Sistemas e Desenvolvimento - Tarde |

Q2518110 Arquitetura de Computadores

O estagiário Bebeto, durante um treinamento, constatou que a primeira implementação de memória virtual foi realizada no início da década de 1960, no sistema Atlas, desenvolvido na Universidade de Manchester (Kilburn, 1962). Atualmente, a maioria dos sistemas implementa memória virtual, com exceção de alguns sistemas operacionais de supercomputadores.

Nesse contexto, Bebeto pode concluir, em relação à funcionalidade da memória virtual dentro de um sistema operacional contemporâneo, que ela:

A

é empregada primordialmente para acelerar a execução direta de instruções na unidade de processamento central (CPU), eliminando a necessidade de armazenamento secundário durante a execução de programas;

B

é uma técnica projetada para reduzir propositadamente a capacidade de memória RAM física acessível pelo sistema, com o intuito de otimizar a alocação de recursos e melhorar a eficiência do sistema por meio de uma gestão de memória mais restritiva;

C

se baseia na utilização de espaço em dispositivos de armazenamento secundário, como discos rígidos, para simular uma capacidade de memória RAM mais extensa, possibilitando assim a execução de programas que excedem o tamanho da memória física disponível;

D

é uma tecnologia obsoleta, visto que os sistemas operacionais modernos dependem de armazenamento secundário para todas as operações de memória;

E

é aplicada ao armazenamento e acesso de dados via soluções de cloud computing, eliminando a necessidade de armazenamento local ao prover um acesso ininterrupto e remoto a recursos de memória virtualizados.

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Q2518108

Ano: 2024 Banca: FGV Órgão: CVM Prova: FGV - 2024 - CVM - Analista CVM - Perfil 8 - TI / Sistemas e Desenvolvimento - Tarde |

Q2518108 Arquitetura de Computadores

No contexto de processadores modernos que implementam técnicas como execução fora de ordem e especulativa, o ciclo de execução de instruções se torna mais complexo.

Considerando essas técnicas avançadas, a opção que descreve um aspecto do processo de execução de instruções que é fundamental para otimizar o desempenho do processador, mantendo a precisão dos resultados, está corretamente descrito em:

A

o processador executa instruções estritamente na ordem em que aparecem no programa, sem considerar a possibilidade de dependências de dados entre instruções subsequentes;

B

antes de buscar instruções na memória, o processador sempre espera a conclusão da execução de todas as instruções anteriores, garantindo a execução sequencial para minimizar erros de previsão de salto;

C

o processador utiliza uma unidade de previsão de salto para executar instruções especulativamente, antes da confirmação de que essas instruções precisam ser executadas, revertendo alterações se a especulação estiver incorreta;

D

as instruções são decodificadas em uma ordem fixa e armazenadas em um buffer até que todos os operandos estejam disponíveis, momento no qual o processador interrompe todas as outras operações para executar essa instrução;

E

para cada instrução, o processador primeiro atualiza o contador de programa e, em seguida, executa uma análise completa do código do programa para identificar possíveis otimizações de execução antes de proceder à busca de instruções.

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Q2518104

Ano: 2024 Banca: FGV Órgão: CVM Prova: FGV - 2024 - CVM - Analista CVM - Perfil 8 - TI / Sistemas e Desenvolvimento - Tarde |

Q2518104 Arquitetura de Computadores

Considerando os conceitos de paralelismo e multiprocessamento em sistemas de computação de alto desempenho, é correto afirmar que:

A

a eficiência do sistema é inversamente proporcional ao número de processadores, ou seja, quanto mais processadores, menor a eficiência do sistema, devido ao aumento da complexidade de gerenciamento;

B

a eficiência do sistema pode ser melhorada até um certo ponto pelo aumento do número de processadores, mas está sujeita à Lei de Amdahl, que estabelece que há um limite para o quanto a performance pode ser aumentada através do paralelismo devido à fração de código que deve ser executada sequencialmente;

C

o multiprocessamento garante que todas as tarefas serão executadas em paralelo, eliminando a necessidade de qualquer execução sequencial e maximizando a eficiência do sistema;

D

em sistemas que implementam paralelismo e multiprocessamento, a eficiência é maximizada apenas quando cada processador executa uma única tarefa de cada vez, sem qualquer forma de troca de contexto ou multitarefa;

E

o uso de técnicas de paralelismo e multiprocessamento implica que não há necessidade de otimizações no código, pois a adição de mais processadores resolve automaticamente quaisquer problemas de desempenho.

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Q2518095

Ano: 2024 Banca: FGV Órgão: CVM Prova: FGV - 2024 - CVM - Analista CVM - Perfil 8 - TI / Sistemas e Desenvolvimento - Tarde |

Q2518095 Arquitetura de Computadores

A arquitetura de um computador define seu conjunto de instruções, modos de endereçamento e tipos de dados, enquanto a organização refere-se aos aspectos operacionais concretos do sistema. Com base nessa distinção, analise as afirmações a seguir sobre um hipotético computador X.

I. O computador X utiliza uma arquitetura de conjunto de instruções complexas (CISC) que permite uma ampla variedade de modos de endereçamento.

II. A organização do computador X inclui um pipeline de instruções de cinco estágios para aumentar a taxa de execução de instruções.

III. A organização do computador X é otimizada para computação em nuvem, utilizando uma matriz de processadores para processamento paralelo.

Com base nessas afirmações, a opção que descreve uma característica que é estritamente parte da organização do computador X é:

A

suporte a uma ampla variedade de modos de endereçamento;

B

utilização de uma arquitetura CISC;

C

suporte a operações de ponto flutuante no conjunto de instruções;

D

implementação de um pipeline de instruções de cinco estágios;

E

otimização para computação em nuvem através de processamento paralelo.

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Q2516056

Ano: 2024 Banca: FGV Órgão: INPE Prova: FGV - 2024 - INPE - Tecnologista Júnior I - Desenvolvimento de Sistemas Eletrônicos Digitais |

Q2516056 Arquitetura de Computadores

Um processador de 32 bits de barramento de dados se conecta com bancos de memória segundo o tradicional esquema utilizado na arquitetura PC.
Portanto, para acessar uma variável de 64 bits localizada a partir de um endereço da forma 4K+1 (resto 1 na divisão por 4), o número de ciclos de barramento consumidos na comunicação é

A

2.

B

3.

C

4.

D

5.

E

8.

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Q2516052

Ano: 2024 Banca: FGV Órgão: INPE Prova: FGV - 2024 - INPE - Tecnologista Júnior I - Desenvolvimento de Sistemas Eletrônicos Digitais |

Q2516052 Arquitetura de Computadores

Considere uma placa FPGA que possui um cristal queimado localizado próximo ao conector USB de configuração da placa. O referido cristal precisa ser substituído, mas sua frequência não está legível.
O mais sensato, em função da sua posição, é substituir o cristal queimado por um cristal, cuja frequência em MHz, é

A

12.

B

27.

C

100.

D

125.

E

311.

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Q2516042

Ano: 2024 Banca: FGV Órgão: INPE Prova: FGV - 2024 - INPE - Tecnologista Júnior I - Desenvolvimento de Sistemas Eletrônicos Digitais |

Q2516042 Arquitetura de Computadores

No desenvolvimento de um sistema hipotético, optou-se por usar uma arquitetura de microprocessador com um maior conjunto de instruções, a arquitetura CISC.
Com relação a arquitetura RISC, assinale a opção que apresenta uma vantagem apresentada pela CISC.

A

Possui instruções mais simples.

B

Suas instruções demandam menos ciclos de clock para sua execução.

C

É mais rápida, pois apresenta menos formas de endereçamento.

D

Permite o desenvolvimento de programas menores.

E

Permite o desempenho otimizado no software.

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Q2516041

Ano: 2024 Banca: FGV Órgão: INPE Prova: FGV - 2024 - INPE - Tecnologista Júnior I - Desenvolvimento de Sistemas Eletrônicos Digitais |

Q2516041 Arquitetura de Computadores

Após analisar o diagrama de blocos de um processador, foi constatado a existência de apenas um barramento para a memória, tanto de dados quanto de instruções.
Da análise do digrama, é correto concluir que a arquitetura usada na construção do processador é a

A

RISC.

B

Unified.

C

Von-Neumann.

D

Harvard.

E

CISC.

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Q2516037

Ano: 2024 Banca: FGV Órgão: INPE Prova: FGV - 2024 - INPE - Tecnologista Júnior I - Desenvolvimento de Sistemas Eletrônicos Digitais |

Q2516037 Arquitetura de Computadores

A representação binária de

0 11111111 00000000000000000000000,

em padrão float32 (IEEE 754), corresponde a

A

+ infinito.

B

não corresponde a um número (NaN).

C

+2¹²⁷.

D

+2²⁵⁵.

E

–2²⁵⁵

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Q2516029

Ano: 2024 Banca: FGV Órgão: INPE Prova: FGV - 2024 - INPE - Tecnologista Júnior I - Desenvolvimento de Sistemas Eletrônicos Digitais |

Q2516029 Arquitetura de Computadores

A Tabela ASCII (American Standard Code for Information Interchange) é um conjunto de caracteres e códigos numéricos utilizados para representar texto em computadores e dispositivos de comunicação.
Desenvolvida inicialmente nos anos 1960, a tabela ASCII atribui um código único de 7 bits para cada caractere alfanumérico, de pontuação, símbolos especiais e comandos de controle. O caractere “~” (til), no código ASCII padrão, possui o código 126 na base decimal.
Assinale a opção que indica sua representação na base octal.

A

117₈

B

126₈

C

173₈

D

176₈

E

177₈

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Questões de Concurso Sobre arquitetura de computadores

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