Questões da Prova CESPE - 2015 - Telebras - Engenheiro - Engenharia da Computação
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Se um barramento de dados tiver mais de uma CPU, uma das soluções para evitar a inconsistência das operações é adotar o ciclo de barramento ler–modificar–escrever.
Entre as contribuições que os sistemas RISC trouxeram para a arquitetura dos computadores, se comparados aos sistemas CISC, estão o maior número de registradores de propósito geral e uma ênfase na otimização no pipeline de instruções.
No método de processamento paralelo secundário passivo, nem sempre o servidor secundário precisa ter acesso aos bancos de dados utilizados pelo servidor primário.
No processamento multicore, o projeto de um processador superescalar inclui bancos de registradores que são replicados a fim de que várias instruções possam compartilhar os estágios do pipeline.
A hierarquização de memórias pelo tempo de acesso faz que a memória com maior velocidade de acesso esteja localizada no nível mais baixo da hierarquia, ou seja, mais distante do processador, a fim de melhorar o desempenho do sistema.