Questões de Concurso Comentadas sobre arquitetura de computadores
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O uso de ___________ visa obter velocidade de memória próxima das memórias mais rápidas que existem e, ao mesmo tempo, disponibilizar uma memória de grande capacidade ao preço de memórias semicondutoras mais baratas.
Analise e indique a alternativa que melhor preenche a lacuna no texto acima:
barramento PCI pode ser configurado como um barramento de 32 ou 64 bits. Estas são divididas em grupos funcionais. Associe cada grupo com suas respectivas particularidades.
I) Pinos do sistema
II) Pinos de endereços e de dados
III) Pinos de controle da interface
a) Incluem os pinos de clock e reset.
b) Incluem 32 linhas que são multiplexadas no tempo para endereços e dados. As outras linhas nesse grupo são usadas para interpretar e validar as linhas de sinal que carregam os endereços e dados.
c) Controlam a temporização de transações e oferecem coordenação entre iniciadores e destinos.
Um ________ pode trocar dados diretamente com o processador. Assim como o processador pode iniciar uma leitura ou escrita com a memória, designando o endereço de um local específico, o processador também pode ler ou escrever dados nele. Nesse último caso, o processador identifica um dispositivo específico que é controlado por ele em particular.
Indique a alternativa que melhor preenche a lacuna no texto acima.
Embora exista uma grande variedade de implementações de barramento diferentes, existem poucos parâmetros ou elementos de projeto básicos que servem para classificar e diferenciar barramentos. As linhas de barramento podem ser separadas em dois tipos genéricos:
Dentro da hierarquia de barramento múltiplo de computadores, se muitos dispositivos estiverem conectados ao barramento, o desempenho será prejudicado. Existem três causas principais:
I) Quando o controle do barramento passa de um dispositivo para outro com frequência, os atrasos de propagação podem afetar visivelmente o desempenho.
II) À medida que a demanda de transferência de dados agregada se aproxima da capacidade do barramento. Como as taxas de dados geradas pelos dispositivos conectados estão crescendo rapidamente, essa é uma corrida que um barramento único por fim está destinado a perder.
III) Quando existe um barramento local que conecta o processador a um controlador de cache, que por sua vez, é conectado a um barramento do sistema que admite memória principal. O controlador de cache é integrado a uma ponte, ou dispositivo de armazenamento temporário (buffer), que se conecta ao barramento, o que afeta o desempenho.
São apresentadas situações prejudiciais ao desempenho do barramento verdadeiras em: