Questões de Concurso

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Q183038 Engenharia Eletrônica
A figura acima mostra a configuração de um circuito, em malha fechada, usando um amplificador operacional considerado ideal. A função de transferência desse amplifica- dor é dada pela expressão
Imagem 032.jpg
Os valores de p e z são, respectivamente,

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Q183036 Engenharia Eletrônica
O número decimal 1.000, expresso em outras bases numéricas, NÃO é

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Q183030 Engenharia Eletrônica
Seja um conversor CC-CC, tipo abaixador, considerado ideal, operando em modo contínuo e em regime permanente, cuja corrente média de entrada é 2 A. Sendo a corrente média de saída igual a 10 A, e a tensão média de entrada igual a 10 V, o valor da tensão média de saída, em volts, será igual a

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Q183026 Engenharia Eletrônica
Considere um conversor tipo CC-CA em ponte completa, monofásico, conforme a figura acima, sendo acionado pela estratégia de chaveamento do tipo PWM bipolar. Nessa estratégia, a frequência da portadora triangular é de 1,8 kHz e valor de pico de 10 V, enquanto a tensão de controle senoidal possui frequência igual a 60 Hz e valor de pico de 8 V.
Esse conversor apresenta quatro chaves controláveis (TA+, TA- , TB+ e TB- ) e seus respectivos diodos em antiparalelo (DA+, DA- , DB+ e DB- ). Adicionalmente, o conversor é alimentado por uma tensão CC constante Vd , e vo é a tensão de saída. Nessas condições, o índice de modulação de frequência (mf ) e o índice de modulação de amplitude (ma ) desse conversor são, respectivamente,

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Q182852 Engenharia Eletrônica
Imagem associada para resolução da questão

Considere um conversor CA-CC monofásico, de onda completa e retificado a diodo. Esse conversor é alimentado por um outro conversor monofásico CC-CA, cuja tensão de saída é uma onda quadrada, de frequência 60 Hz, mostrada na figura acima. Supondo-se que os dois conversores são considerados ideais, o valor da potência média, em watts, dissipada em uma resistência de 10 Ω conectada no lado CC do retificador, é
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Q182849 Engenharia Eletrônica
Uma sequência binária é transmitida particionando-a em quadros contíguos de 8 bits, sendo que cada quadro tem duração de 100 µseg. Essa sequência é aplicada à entrada de um codificador, que adiciona 1 bit extra a cada quadro, para que, no receptor, seja possível implementar um processo de detecção de erro por verificação de paridade. Admitindo-se que a duração do quadro não é alterada pelo codificador, a taxa de bits da sequência, na saída do codificador, em kbps, é
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Q182848 Engenharia Eletrônica
Na transmissão de dados, dois esquemas básicos para detecção e correção de erros podem ser empregados: ARQ (Automatic Repeat Request) e FEC (Forward Error Correction). Uma vantagem do esquema FEC, em relação ao esquema ARQ, é a de que
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Q182846 Engenharia Eletrônica
A representação da forma de onda de uma sequência binária é realizada, geralmente, por meio de um código de linha. Alguns dos códigos mais conhecidos são: BRZ (Bipolar Return-to-zero), Manchester, NRZ (Nonreturn-to-zero), On-Off e RZ (Return-to-zero). Seja X uma sequência binária, cuja quantidade de dígitos 1 (nível lógico positivo) é maior do que a quantidade de dígitos 0 (nível lógico negativo). Desses códigos de linha, o que gera uma forma de onda referente à sequência X com nível DC igual a zero, é
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Q182836 Engenharia Eletrônica
Um pulso retangular, de amplitude constante e positiva, definido em um intervalo de tempo de largura T [s], e com amplitude nula fora desse intervalo, é aplicado a um filtro passa-baixas, com ganho unitário, cuja banda passante é menor do que 1/T [Hz]. Afirma-se que o pulso obtido na saída do filtro, em relação ao pulso de entrada, apresenta
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Q182832 Engenharia Eletrônica
Imagem associada para resolução da questão

Considere um contador binário de 4 bits, cujas tabelas de operação e de ligações estão mostradas acima. O contador dispõe dos sinais LOAD (carregamento paralelo sincronizado pelo clock), CLR (clear síncrono) e EN (habilitador de contagem a cada clock), todos ativados em nível alto, além do sinal UP, que define a direção de contagem. Sabendo-se que a habilitação de LOAD tem prioridade sobre a habilitação de contagem, o número de estados da sequência permanente implementada é


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Q182829 Engenharia Eletrônica
Na arquitetura do PC, o componente ligado diretamente à Ponte Norte é
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Q182828 Engenharia Eletrônica
O número de mintermos (combinações dos sinais D, C, B e A) que ativam a função F(D,C,B,A) = (A+B)
Imagem associada para resolução da questãoé
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Q182705 Engenharia Eletrônica
Qual componente é normalmente empregado em sistemas de automação industrial?
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Q182577 Engenharia Eletrônica
Ao se simplificar a equação lógica

                        Imagem 009.jpg

a lógica de programação Ladder correspondente é
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Q182394 Engenharia Eletrônica
Imagem 003.jpg

O diagrama em blocos da figura acima mostra um sistema linear com entrada U(s) e saída Y(s). Com base nos dados do diagrama, os polos desse sistema em malha fechada são
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Q182393 Engenharia Eletrônica
Imagem 001.jpg

O gráfico da figura acima corresponde à resposta ao degrau unitário de um sistema de 2ª ordem, cuja função de transferência éImagem 002.jpg . Com base nos dados da figura, o valor da Frequência Natural Não Amortecida é
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Q182343 Engenharia Eletrônica
A lógica de programação correspondente à simplificação do Ladder acima é

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Q182342 Engenharia Eletrônica
Na simplificação da equação lógica Imagem 012.jpg , a lógica de programação Ladder correspondente é

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Q182284 Engenharia Eletrônica
O diodo é um dispositivo eletrônico importante, composto, basicamente, de material semicondutor como silício ou germânio. Qual a finalidade de sua utilização em circuitos eletrônicos?
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Ano: 2011 Banca: FCC Órgão: INFRAERO Prova: FCC - 2011 - INFRAERO - Engenheiro Eletrônico |
Q181894 Engenharia Eletrônica
A figura abaixo representa um diagrama em linguagem LADDER:
Imagem 022.jpg
A expressão lógica que o representa é:

Alternativas
Respostas
1881: D
1882: C
1883: E
1884: D
1885: D
1886: C
1887: D
1888: B
1889: C
1890: E
1891: B
1892: D
1893: E
1894: B
1895: A
1896: E
1897: B
1898: A
1899: D
1900: E