Questões de Engenharia Eletrônica para Concurso
Foram encontradas 3.780 questões
Ano: 2024
Banca:
CESPE / CEBRASPE
Órgão:
CTI
Prova:
CESPE / CEBRASPE - 2024 - CTI - Pesquisador Associado I - Especialidade: Tecnologias Habilitadoras - Área de Atuação: Micro e Nanotecnologia |
Q2364419
Engenharia Eletrônica
Julgue o item subsequente, com relação a projeto, implementação, simulação em HDL, leiaute e verificação física de circuitos mistos.
Na implementação de um PLL (phase-locked loop) em modo misto usando Verilog HDL, é aconselhável utilizar o mesmo conjunto de primitivas e elementos de modelagem empregados para blocos digitais, como flip-flops e lógica combinacional, para garantir a coerência na representação do comportamento do sistema de controle de fase e frequência.
Na implementação de um PLL (phase-locked loop) em modo misto usando Verilog HDL, é aconselhável utilizar o mesmo conjunto de primitivas e elementos de modelagem empregados para blocos digitais, como flip-flops e lógica combinacional, para garantir a coerência na representação do comportamento do sistema de controle de fase e frequência.
Ano: 2024
Banca:
CESPE / CEBRASPE
Órgão:
CTI
Prova:
CESPE / CEBRASPE - 2024 - CTI - Pesquisador Associado I - Especialidade: Tecnologias Habilitadoras - Área de Atuação: Micro e Nanotecnologia |
Q2364418
Engenharia Eletrônica
Julgue o item subsequente, com relação a projeto, implementação, simulação em HDL, leiaute e verificação física de circuitos mistos.
Na verificação física de sistemas VLSI em modo misto, a integridade do sinal e as considerações de ruído são menos críticas para circuitos analógicos que para circuitos digitais, tornando o roteamento e a disposição dos componentes analógicos menos importantes no processo de design.
Na verificação física de sistemas VLSI em modo misto, a integridade do sinal e as considerações de ruído são menos críticas para circuitos analógicos que para circuitos digitais, tornando o roteamento e a disposição dos componentes analógicos menos importantes no processo de design.
Ano: 2024
Banca:
CESPE / CEBRASPE
Órgão:
CTI
Prova:
CESPE / CEBRASPE - 2024 - CTI - Pesquisador Associado I - Especialidade: Tecnologias Habilitadoras - Área de Atuação: Micro e Nanotecnologia |
Q2364417
Engenharia Eletrônica
Julgue o item subsequente, com relação a projeto,
implementação, simulação em HDL, leiaute e verificação física
de circuitos mistos.
As linguagens HDL, como VHDL e Verilog, em conjunto com extensões associadas podem ser úteis para a simulação de sistemas VLSI em modo misto, pois permitem a modelagem com precisão adequada tanto de componentes digitais quanto analógicos, facilitando a análise e verificação do design antes da fabricação física.
As linguagens HDL, como VHDL e Verilog, em conjunto com extensões associadas podem ser úteis para a simulação de sistemas VLSI em modo misto, pois permitem a modelagem com precisão adequada tanto de componentes digitais quanto analógicos, facilitando a análise e verificação do design antes da fabricação física.
Ano: 2024
Banca:
CESPE / CEBRASPE
Órgão:
CTI
Prova:
CESPE / CEBRASPE - 2024 - CTI - Pesquisador Associado I - Especialidade: Tecnologias Habilitadoras - Área de Atuação: Micro e Nanotecnologia |
Q2364416
Engenharia Eletrônica
Julgue o item que se segue, em relação a projeto de sistemas e circuitos integrados com dispositivos de baixo consumo e alta eficiência energética e a aplicações em sistemas puramente digitais ou com sinais mistos.
As abordagens de design para circuitos analógicos diferem significativamente das utilizadas em circuitos digitais, principalmente no que diz respeito à gestão de ruídos e variações de sinal; além disso, a integração de componentes analógicos em designs de modo misto requer considerações adicionais para assegurar a compatibilidade e o desempenho efetivo do circuito integrado como um todo.
As abordagens de design para circuitos analógicos diferem significativamente das utilizadas em circuitos digitais, principalmente no que diz respeito à gestão de ruídos e variações de sinal; além disso, a integração de componentes analógicos em designs de modo misto requer considerações adicionais para assegurar a compatibilidade e o desempenho efetivo do circuito integrado como um todo.
Ano: 2024
Banca:
CESPE / CEBRASPE
Órgão:
CTI
Prova:
CESPE / CEBRASPE - 2024 - CTI - Pesquisador Associado I - Especialidade: Tecnologias Habilitadoras - Área de Atuação: Micro e Nanotecnologia |
Q2364414
Engenharia Eletrônica
Julgue o item que se segue, em relação a projeto de sistemas e circuitos integrados com dispositivos de baixo consumo e alta eficiência energética e a aplicações em sistemas puramente digitais ou com sinais mistos.
Nos circuitos integrados VLSI de modo misto que priorizam a eficiência energética e a minimização de consumo, a concepção de amplificadores diferenciais é invariavelmente orientada pelo uso exclusivo de transistores PMOS.
Nos circuitos integrados VLSI de modo misto que priorizam a eficiência energética e a minimização de consumo, a concepção de amplificadores diferenciais é invariavelmente orientada pelo uso exclusivo de transistores PMOS.
Ano: 2024
Banca:
CESPE / CEBRASPE
Órgão:
CTI
Prova:
CESPE / CEBRASPE - 2024 - CTI - Pesquisador Associado I - Especialidade: Tecnologias Habilitadoras - Área de Atuação: Micro e Nanotecnologia |
Q2364413
Engenharia Eletrônica
Julgue o item que se segue, em relação a projeto de sistemas e circuitos integrados com dispositivos de baixo consumo e alta eficiência energética e a aplicações em sistemas puramente digitais ou com sinais mistos.
Em sistemas CMOS VLSI, a integração de materiais piezoelétricos com avanços em nanotecnologia é realizada geralmente por meio de abordagens híbridas, em que os componentes são fabricados separadamente e depois combinados com o chip CMOS; isso assegura a eficiência e funcionalidade do conjunto, contribuindo significativamente para a sustentabilidade e autonomia energética desses dispositivos, sem comprometer as características individuais de cada tecnologia.
Em sistemas CMOS VLSI, a integração de materiais piezoelétricos com avanços em nanotecnologia é realizada geralmente por meio de abordagens híbridas, em que os componentes são fabricados separadamente e depois combinados com o chip CMOS; isso assegura a eficiência e funcionalidade do conjunto, contribuindo significativamente para a sustentabilidade e autonomia energética desses dispositivos, sem comprometer as características individuais de cada tecnologia.
Ano: 2024
Banca:
CESPE / CEBRASPE
Órgão:
CTI
Prova:
CESPE / CEBRASPE - 2024 - CTI - Pesquisador Associado I - Especialidade: Tecnologias Habilitadoras - Área de Atuação: Micro e Nanotecnologia |
Q2364412
Engenharia Eletrônica
Julgue o item que se segue, em relação a projeto de sistemas e circuitos integrados com dispositivos de baixo consumo e alta eficiência energética e a aplicações em sistemas puramente digitais ou com sinais mistos.
A tecnologia de semicondutor de óxido metálico complementar destaca-se no cenário de implementação de sinais mistos em tecnologia VLSI por sua capacidade de otimizar a densidade e a eficiência energética na esfera digital, bem como à sua versatilidade em fornecer um leque diversificado e adequado de componentes para a elaboração de projetos no espectro analógico.
A tecnologia de semicondutor de óxido metálico complementar destaca-se no cenário de implementação de sinais mistos em tecnologia VLSI por sua capacidade de otimizar a densidade e a eficiência energética na esfera digital, bem como à sua versatilidade em fornecer um leque diversificado e adequado de componentes para a elaboração de projetos no espectro analógico.
Ano: 2024
Banca:
CESPE / CEBRASPE
Órgão:
CTI
Prova:
CESPE / CEBRASPE - 2024 - CTI - Pesquisador Associado I - Especialidade: Tecnologias Habilitadoras - Área de Atuação: Micro e Nanotecnologia |
Q2364411
Engenharia Eletrônica
Julgue o item que se segue, em relação a projeto de sistemas e
circuitos integrados com dispositivos de baixo consumo e alta
eficiência energética e a aplicações em sistemas puramente
digitais ou com sinais mistos.
Em projetos de sistemas VLSI de modo misto, a utilização de áreas de guarda (guard rings) e a separação física dos blocos analógicos e digitais visam minimizar a interferência indesejada, garantindo a integridade do sinal analógico e o desempenho adequado do sistema como um todo.
Em projetos de sistemas VLSI de modo misto, a utilização de áreas de guarda (guard rings) e a separação física dos blocos analógicos e digitais visam minimizar a interferência indesejada, garantindo a integridade do sinal analógico e o desempenho adequado do sistema como um todo.
Ano: 2024
Banca:
CESPE / CEBRASPE
Órgão:
CTI
Prova:
CESPE / CEBRASPE - 2024 - CTI - Pesquisador Associado I - Especialidade: Tecnologias Habilitadoras - Área de Atuação: Micro e Nanotecnologia |
Q2364410
Engenharia Eletrônica
Considerando a figura precedente, que ilustra a geometria de uma porta do tipo MOS, julgue o item a seguir.
A resistência elétrica da camada dielétrica de óxido sob a
porta metálica do MOSFET é inferior à resistência do canal
semicondutor quando polarizado.
Ano: 2024
Banca:
CESPE / CEBRASPE
Órgão:
CTI
Prova:
CESPE / CEBRASPE - 2024 - CTI - Pesquisador Associado I - Especialidade: Tecnologias Habilitadoras - Área de Atuação: Micro e Nanotecnologia |
Q2364409
Engenharia Eletrônica
Considerando a figura precedente, que ilustra a geometria de uma porta do tipo MOS, julgue o item a seguir.
Nas regiões de dreno e fonte do MOSFET ilustrado, a
dopagem é superior àquela aplicada ao substrato tipo p.
Ano: 2024
Banca:
CESPE / CEBRASPE
Órgão:
CTI
Prova:
CESPE / CEBRASPE - 2024 - CTI - Pesquisador Associado I - Especialidade: Tecnologias Habilitadoras - Área de Atuação: Micro e Nanotecnologia |
Q2364408
Engenharia Eletrônica
Considerando a figura precedente, que ilustra a geometria de uma porta do tipo MOS, julgue o item a seguir.
A ilustração mostra a estrutura de um transistor PMOS do
tipo depleção.
Ano: 2024
Banca:
CESPE / CEBRASPE
Órgão:
CTI
Prova:
CESPE / CEBRASPE - 2024 - CTI - Pesquisador Associado I - Especialidade: Tecnologias Habilitadoras - Área de Atuação: Micro e Nanotecnologia |
Q2364407
Engenharia Eletrônica
Considerando a figura precedente, que ilustra a geometria de uma porta do tipo MOS, julgue o item a seguir.
Na ilustração, a dimensão identificada por W corresponde à
largura do canal do MOSFET.
Ano: 2024
Banca:
CESPE / CEBRASPE
Órgão:
CTI
Prova:
CESPE / CEBRASPE - 2024 - CTI - Pesquisador Associado I - Especialidade: Tecnologias Habilitadoras - Área de Atuação: Micro e Nanotecnologia |
Q2364406
Engenharia Eletrônica
A partir dos diagramas de blocos e esquemático de um amplificador operacional, apresentados anteriormente, julgue o próximo item.
No processo de design de um amplificador operacional CMOS, a seleção do tamanho dos dispositivos MOSFET e das correntes de polarização tem influência direta em parâmetros tais como ganho, CMRR, dissipação de potência, ruído e taxa de variação (slew rate). Esse processo é iterativo e requer ajustes baseados em simulações, em que aumentar o tamanho dos MOSFETs (aumentando W) com uma menor VGS (tensão entre porta e fonte) pode melhorar o emparelhamento, aumentar o ganho e reduzir o ruído, porém, podendo resultar em uma área de layout maior e potencialmente em menor velocidade de operação.
No processo de design de um amplificador operacional CMOS, a seleção do tamanho dos dispositivos MOSFET e das correntes de polarização tem influência direta em parâmetros tais como ganho, CMRR, dissipação de potência, ruído e taxa de variação (slew rate). Esse processo é iterativo e requer ajustes baseados em simulações, em que aumentar o tamanho dos MOSFETs (aumentando W) com uma menor VGS (tensão entre porta e fonte) pode melhorar o emparelhamento, aumentar o ganho e reduzir o ruído, porém, podendo resultar em uma área de layout maior e potencialmente em menor velocidade de operação.
Ano: 2024
Banca:
CESPE / CEBRASPE
Órgão:
CTI
Prova:
CESPE / CEBRASPE - 2024 - CTI - Pesquisador Associado I - Especialidade: Tecnologias Habilitadoras - Área de Atuação: Micro e Nanotecnologia |
Q2364405
Engenharia Eletrônica
A partir dos diagramas de blocos e esquemático de um
amplificador operacional, apresentados anteriormente, julgue o próximo item.
No amplificador operacional CMOS mostrado, o amplificador diferencial deve fornecer a maior parte do ganho do sistema, enquanto o estágio de ganho em fonte comum serve principalmente para prover a compensação de frequência necessária; o buffer de saída é utilizado para equalizar as tensões de entrada diferencial sem amplificar o sinal.
No amplificador operacional CMOS mostrado, o amplificador diferencial deve fornecer a maior parte do ganho do sistema, enquanto o estágio de ganho em fonte comum serve principalmente para prover a compensação de frequência necessária; o buffer de saída é utilizado para equalizar as tensões de entrada diferencial sem amplificar o sinal.
Ano: 2024
Banca:
CESPE / CEBRASPE
Órgão:
CTI
Prova:
CESPE / CEBRASPE - 2024 - CTI - Pesquisador Associado I - Especialidade: Tecnologias Habilitadoras - Área de Atuação: Micro e Nanotecnologia |
Q2364404
Engenharia Eletrônica
Em relação a circuitos integrados em larga escala de fabricação (VLSI), julgue o item que se segue.
Nos circuitos CMOS, devido à diferença de mobilidade entre
lacunas e elétrons em materiais semicondutores, os
transistores NMOS usados em circuitos digitais têm
aproximadamente o dobro do tamanho dos transistores
PMOS.
Ano: 2024
Banca:
CESPE / CEBRASPE
Órgão:
CTI
Prova:
CESPE / CEBRASPE - 2024 - CTI - Pesquisador Associado I - Especialidade: Tecnologias Habilitadoras - Área de Atuação: Micro e Nanotecnologia |
Q2364403
Engenharia Eletrônica
Em relação a circuitos integrados em larga escala de fabricação (VLSI), julgue o item que se segue.
Em materiais semicondutores fabricados com silício, a
mobilidade de elétrons é maior que a mobilidade das
lacunas, por isso, na fabricação de circuitos de alto
desempenho e baixo consumo, é empregada,
predominantemente, a tecnologia que utiliza apenas
transistores NMOS.
Ano: 2024
Banca:
CESPE / CEBRASPE
Órgão:
CTI
Prova:
CESPE / CEBRASPE - 2024 - CTI - Pesquisador Associado I - Especialidade: Tecnologias Habilitadoras - Área de Atuação: Micro e Nanotecnologia |
Q2364402
Engenharia Eletrônica
Em relação a circuitos integrados em larga escala de fabricação (VLSI), julgue o item que se segue.
O diagrama a seguir ilustra uma configuração compatível com uma porta lógica inversora CMOS, com a entrada representada por Ve e a saída, pela tensão Vs.
Ano: 2024
Banca:
CESPE / CEBRASPE
Órgão:
CTI
Prova:
CESPE / CEBRASPE - 2024 - CTI - Pesquisador Associado I - Especialidade: Tecnologias Habilitadoras - Área de Atuação: Micro e Nanotecnologia |
Q2364401
Engenharia Eletrônica
Em relação a circuitos integrados em larga escala de fabricação (VLSI), julgue o item que se segue.
O diagrama a seguir ilustra uma configuração compatível com uma porta lógica NOR CMOS, com as entradas representadas por VA e VB a saída, pela tensão VS.
Ano: 2024
Banca:
CESPE / CEBRASPE
Órgão:
CTI
Prova:
CESPE / CEBRASPE - 2024 - CTI - Pesquisador Associado I - Especialidade: Tecnologias Habilitadoras - Área de Atuação: Micro e Nanotecnologia |
Q2364390
Engenharia Eletrônica
Com relação à operação dos MOSFET, julgue o item a seguir.
Em um dispositivo MOSFET, quando a tensão aplicada entre
os terminais porta-f onte é menor que a tensão limiar, os
portadores de carga do dispositivo se movimentam de forma
semelhante aos de um transistor bipolar.
Q2361810
Engenharia Eletrônica
Analise as seguintes asserções e a relação proposta entre elas:
I. Os sistemas de máquinas de visão utilizam câmeras inteligentes ou digitais com software de processamento de imagens baseados em computadores para realizar inspeções em peças que estão em fase de fabricação e avaliar sua qualidade, sendo também programados para realizar tarefas simples, como contar objetos em uma esteira, ler números seriais e medir peças.
PORQUE
II. Embora alguns algoritmos de máquinas de visão tenham sido desenvolvidos para imitar a percepção da visão humana, nenhuma máquina de sistema de visão tem a capacidade da visão humana em termos de compreensão de imagens, tolerância às variações de iluminação e variabilidade de partes.
A respeito dessas asserções, assinale a alternativa correta.
I. Os sistemas de máquinas de visão utilizam câmeras inteligentes ou digitais com software de processamento de imagens baseados em computadores para realizar inspeções em peças que estão em fase de fabricação e avaliar sua qualidade, sendo também programados para realizar tarefas simples, como contar objetos em uma esteira, ler números seriais e medir peças.
PORQUE
II. Embora alguns algoritmos de máquinas de visão tenham sido desenvolvidos para imitar a percepção da visão humana, nenhuma máquina de sistema de visão tem a capacidade da visão humana em termos de compreensão de imagens, tolerância às variações de iluminação e variabilidade de partes.
A respeito dessas asserções, assinale a alternativa correta.
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