Questões de Engenharia Eletrônica - Flip-flops para Concurso
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Com relação a sistemas e dispositivos digitais, julgue o item seguinte.
No flip-flop JK do tipo mestre-escravo, se as entradas J e K
estiverem todo o tempo conectadas ao nível lógico 1, então a
saída Q, após sucessivos ciclos de relógio, permanecerá no
nível lógico 1.
![Imagem associada para resolução da questão](https://arquivos.qconcursos.com/images/provas/51012/6d4c16eb3efe686f471d.png)
O circuito abaixo trata de um gerador de sequência, em anel, implementado com Flip Flop tipo D e porta lógica.
A sequência de loop, em numeração decimal, executada pelo gerador, é o que consta em
![Imagem associada para resolução da questão](https://arquivos.qconcursos.com/images/provas/20138/3258f36395732701d4ed.png)
A Figura 1, acima, mostra um diagrama de quatro estados definidos pelos bits B e A, sendo B o mais significativo, e pelo bit de controle C.
A Figura 2, por sua vez, mostra uma implementação síncrona desse diagrama de estados com o uso de flip-flops D e das lógicas A e B.
Estas lógicas devem ser, respectivamente: