Questões de Concurso Público CEMIG - MG 2018 para Engenheiro de Telecomunicações JR

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Q2216465
Engenharia de Telecomunicações Circuitos ,
Ano: 2018 Banca: FUMARC Órgão: CEMIG - MG Prova: FUMARC - 2018 - CEMIG - MG - Engenheiro de Telecomunicações JR |
Q2216465 Engenharia de Telecomunicações
O primário do transformador do circuito abaixo está alimentado com uma tensão alternada senoidal com valor eficaz igual a 127 V e frequência igual a 60 Hz. Tanto o transformador quanto os diodos devem ser modelados como ideais. Se o diodo D1 for retirado do circuito, é INCORRETO afirmar: Imagem associada para resolução da questão
Alternativas
Q2216466
Engenharia de Telecomunicações Circuitos ,
Ano: 2018 Banca: FUMARC Órgão: CEMIG - MG Prova: FUMARC - 2018 - CEMIG - MG - Engenheiro de Telecomunicações JR |
Q2216466 Engenharia de Telecomunicações

O transistor do circuito abaixo tem as seguintes características: VBE = 700mV e hFE = β = 120. Esse transistor deve ser polarizado para trabalhar em classe A, com VCE = VCC/2. De acordo com as informações fornecidas, o valor do resistor RB é:


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Alternativas
Q2216467
Engenharia de Telecomunicações Circuitos ,
Ano: 2018 Banca: FUMARC Órgão: CEMIG - MG Prova: FUMARC - 2018 - CEMIG - MG - Engenheiro de Telecomunicações JR |
Q2216467 Engenharia de Telecomunicações
No circuito abaixo, considere o amplificador operacional ideal alimentado com umafonte simétrica de ± 15 V e com valor de saturação da saída igual à tensão dealimentação. De acordo com o gráfico da função de transferência mostrado, o valordo resistor RX é: Imagem associada para resolução da questão
Alternativas
Q2216468
Engenharia de Telecomunicações Circuitos ,
Ano: 2018 Banca: FUMARC Órgão: CEMIG - MG Prova: FUMARC - 2018 - CEMIG - MG - Engenheiro de Telecomunicações JR |
Q2216468 Engenharia de Telecomunicações
Em relação aos circuitos abaixo, podemos afirmar que são funcionalmente equivalentes os circuitos
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Alternativas
Q2216469
Engenharia de Telecomunicações Circuitos ,
Ano: 2018 Banca: FUMARC Órgão: CEMIG - MG Prova: FUMARC - 2018 - CEMIG - MG - Engenheiro de Telecomunicações JR |
Q2216469 Engenharia de Telecomunicações
No circuito abaixo, o sinal de entrada R fica em nível lógico ‘0’ por 10 ms após a energização do circuito, permanecendo após esse tempo em nível lógico ‘1’. O sinal de entrada C, inicialmente em nível lógico ‘0’, troca de valor a cada 50 ms. Decorridos 480 ms após a energização do circuito, o estado lógico do conjunto das saídas Q2, Q1 e Q0, nessa ordem, é:

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Alternativas
Respostas
6: C
7: B
8: B
9: B
10: D
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