Questões de Concurso Para profissional de nível superior
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Ano: 2012
Banca:
CESGRANRIO
Órgão:
Chesf
Prova:
CESGRANRIO - 2012 - Chesf - Profissional de Nível Superior - Eletrônica ou Telecomunicações |
Q457408
Redes de Computadores
No que diz respeito ao protocolo DHCP (Dynamic Host Configuration Protocol) empregado em redes TCP/IP, considere as afirmações abaixo.
I - O chamado pool de endereços corresponde ao conjunto de endereços IP que fazem parte do escopo, mas que não pertencem ao intervalo de exclusão.
II - Quando uma estação de trabalho se conecta à sub-rede, ela recebe do servidor DHCP a concessão de um endereço IP, que é mantida até que a referida estação se desconecte da rede.
III - Uma reserva é realizada, associando-se um endereço IP ao endereço MAC de uma estação de trabalho conectada à rede, de modo que essa estação receba sempre o mesmo endereço IP quando se conectar à rede.
Está correto APENAS o que se afirma em
I - O chamado pool de endereços corresponde ao conjunto de endereços IP que fazem parte do escopo, mas que não pertencem ao intervalo de exclusão.
II - Quando uma estação de trabalho se conecta à sub-rede, ela recebe do servidor DHCP a concessão de um endereço IP, que é mantida até que a referida estação se desconecte da rede.
III - Uma reserva é realizada, associando-se um endereço IP ao endereço MAC de uma estação de trabalho conectada à rede, de modo que essa estação receba sempre o mesmo endereço IP quando se conectar à rede.
Está correto APENAS o que se afirma em
Ano: 2012
Banca:
CESGRANRIO
Órgão:
Chesf
Prova:
CESGRANRIO - 2012 - Chesf - Profissional de Nível Superior - Eletrônica ou Telecomunicações |
Q457407
Engenharia de Telecomunicações
Texto associado
Na figura, está representado o diagrama de blocos de um receptor super-heterodino, onde o amplificador de RF possui uma banda passante muito ampla, o oscilador local foi ajustado para a frequência de 170 MHz, e o filtro de FI está sintonizado na frequência de 20 MHz.
Na configuração representada, é INCORRETO concluir que o receptor super-heterodino
Ano: 2012
Banca:
CESGRANRIO
Órgão:
Chesf
Prova:
CESGRANRIO - 2012 - Chesf - Profissional de Nível Superior - Eletrônica ou Telecomunicações |
Q457406
Arquitetura de Computadores
Texto associado
O programa descrito a seguir foi executado em um microprocessador com arquitetura x86 de 32 bits:
Dessa forma, ao final da execução do programa acima, o conteúdo do registrador AX, em formato hexadecimal, é dado por
Ano: 2012
Banca:
CESGRANRIO
Órgão:
Chesf
Prova:
CESGRANRIO - 2012 - Chesf - Profissional de Nível Superior - Eletrônica ou Telecomunicações |
Q457405
Arquitetura de Computadores
Texto associado
A memória cache de um microprocessador possui capacidade de 512 Kbytes e está organizada em 8.192 linhas de 64 bytes cada uma, conforme mostrado na figura.
Quando o processador precisa acessar um byte na memória RAM, armazenado na faixa de endereços que vai de 000000h até 07FFFFh, o controlador do cache verifica se o dado do endereço desejado está copiado em alguma das linhas da memória cache na faixa de 0000h até 0003h. Caso o dado desejado esteja copiado em alguma linha dessa faixa, o dado é lido diretamente da memória cache, evitando o acesso à memória RAM dinâmica. Caso o dado desejado não esteja copiado em alguma das linhas da memória cache na faixa de 0000h até 0003h, então o controlador de cache deve copiar a linha inteira de 64 bytes da memória RAM, que contém o byte desejado para uma das linhas de memória cache na faixa de 0000h até 0003h, pois é grande a probabilidade de o microprocessador futuramente necessitar acessar outro dado armazenado nessa mesma linha.
Com base na descrição acima, conclui-se que o microprocessador em questão emprega um mapeamento de cache denominado
Com base na descrição acima, conclui-se que o microprocessador em questão emprega um mapeamento de cache denominado
Ano: 2012
Banca:
CESGRANRIO
Órgão:
Chesf
Prova:
CESGRANRIO - 2012 - Chesf - Profissional de Nível Superior - Eletrônica ou Telecomunicações |
Q457404
Engenharia Eletrônica
Em um microcontrolador, dispõe-se de um temporizador (timer), implementado a partir de um contador de oito bits, onde a frequência de clock empregada no circuito do timer é de 4 MHz.
Um projetista necessita empregar esse timer para disparar uma rotina de interrupção no microcontrolador a cada 1,0 ms.
Desse modo, o menor fator de escala que deve ser utilizado no prescaler do timer em questão é de
Um projetista necessita empregar esse timer para disparar uma rotina de interrupção no microcontrolador a cada 1,0 ms.
Desse modo, o menor fator de escala que deve ser utilizado no prescaler do timer em questão é de
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