Questões de Concurso
Sobre eletrônica digital na engenharia eletrônica em engenharia eletrônica
Foram encontradas 888 questões
Ano: 2011
Banca:
FCC
Órgão:
TRT - 23ª REGIÃO (MT)
Prova:
FCC - 2011 - TRT - 23ª REGIÃO (MT) - Analista Judiciário - Engenharia Elétrica |
Q180906
Engenharia Eletrônica
Estão corretamente apresentadas duas condições de entrada e seus respectivos níveis lógicos de saída em
Ano: 2011
Banca:
FCC
Órgão:
TRT - 23ª REGIÃO (MT)
Prova:
FCC - 2011 - TRT - 23ª REGIÃO (MT) - Analista Judiciário - Engenharia Elétrica |
Q180897
Engenharia Eletrônica
O número (C6) 16 convertido para os sistemas numéricos decimal e binário vale, respectivamente,
Ano: 2011
Banca:
CESGRANRIO
Órgão:
Transpetro
Prova:
CESGRANRIO - 2011 - Transpetro - Técnico de Manutenção Júnior - Automação |
Q180776
Engenharia Eletrônica
Uma estação terminal remota (RTU) é capaz de aquisitar e transmitir dados, medidos através de sensores instalados em um processo, para sistemas SCADA (Supervisory Control and Data Acquisition).
PORQUE
A estação terminal remota é um dispositivo eletrônico controlado por microprocessador que possui, além de outros componentes, conversores A/D e portas de comunicação.
Analisando-se as afirmações acima, conclui-se que
PORQUE
A estação terminal remota é um dispositivo eletrônico controlado por microprocessador que possui, além de outros componentes, conversores A/D e portas de comunicação.
Analisando-se as afirmações acima, conclui-se que
Ano: 2008
Banca:
CESPE / CEBRASPE
Órgão:
SEPLAG-DF
Prova:
CESPE - 2008 - SEPLAG-DF - Professor - Eletrônica |
Q161879
Engenharia Eletrônica
Texto associado
A figura acima, na forma de blocos, mostra o esquema básico de
uma read only memory (ROM) genérica.
A partir dessas informações, julgue os itens que se seguem.
A figura acima, na forma de blocos, mostra o esquema básico de
uma read only memory (ROM) genérica.
A partir dessas informações, julgue os itens que se seguem.
A matriz de dados é construída fisicamente somente com resistores e amplificadores operacionais.
Ano: 2008
Banca:
CESPE / CEBRASPE
Órgão:
SEPLAG-DF
Prova:
CESPE - 2008 - SEPLAG-DF - Professor - Eletrônica |
Q161878
Engenharia Eletrônica
Texto associado
A figura acima, na forma de blocos, mostra o esquema básico de
uma read only memory (ROM) genérica.
A partir dessas informações, julgue os itens que se seguem.
A figura acima, na forma de blocos, mostra o esquema básico de
uma read only memory (ROM) genérica.
A partir dessas informações, julgue os itens que se seguem.
Existe um conjunto de chaves na saída, os denominados buffers, que são habilitados por meio do terminal 
Ano: 2008
Banca:
CESPE / CEBRASPE
Órgão:
SEPLAG-DF
Prova:
CESPE - 2008 - SEPLAG-DF - Professor - Eletrônica |
Q161877
Engenharia Eletrônica
Texto associado
A figura acima, na forma de blocos, mostra o esquema básico de
uma read only memory (ROM) genérica.
A partir dessas informações, julgue os itens que se seguem.
A figura acima, na forma de blocos, mostra o esquema básico de
uma read only memory (ROM) genérica.
A partir dessas informações, julgue os itens que se seguem.
A matriz de dados é o local onde ocorre a gravação dos dados na ROM.
Ano: 2008
Banca:
CESPE / CEBRASPE
Órgão:
SEPLAG-DF
Prova:
CESPE - 2008 - SEPLAG-DF - Professor - Eletrônica |
Q161876
Engenharia Eletrônica
Texto associado
A figura acima mostra um Flip-Flop do tipo JK mestre-escravo
com entrada preset (PR) e clear (CLR). Considerando essas
informações, julgue os itens seguintes.
A figura acima mostra um Flip-Flop do tipo JK mestre-escravo
com entrada preset (PR) e clear (CLR). Considerando essas
informações, julgue os itens seguintes.
Os controles PR e CLR dependem da entrada clock para atuarem.
Ano: 2008
Banca:
CESPE / CEBRASPE
Órgão:
SEPLAG-DF
Prova:
CESPE - 2008 - SEPLAG-DF - Professor - Eletrônica |
Q161875
Engenharia Eletrônica
Texto associado
A figura acima mostra um Flip-Flop do tipo JK mestre-escravo
com entrada preset (PR) e clear (CLR). Considerando essas
informações, julgue os itens seguintes.
A figura acima mostra um Flip-Flop do tipo JK mestre-escravo
com entrada preset (PR) e clear (CLR). Considerando essas
informações, julgue os itens seguintes.
Os controles de PR e clear (CLR) estão simultaneamente ligados aos circuitos mestre e escravo.
Ano: 2008
Banca:
CESPE / CEBRASPE
Órgão:
SEPLAG-DF
Prova:
CESPE - 2008 - SEPLAG-DF - Professor - Eletrônica |
Q161874
Engenharia Eletrônica
Texto associado
A figura acima mostra um Flip-Flop do tipo JK mestre-escravo
com entrada preset (PR) e clear (CLR). Considerando essas
informações, julgue os itens seguintes.
A figura acima mostra um Flip-Flop do tipo JK mestre-escravo
com entrada preset (PR) e clear (CLR). Considerando essas
informações, julgue os itens seguintes.
Suponha que o controle de preset (PR) assuma o valor zero. Então, para esta condição, a saída Q do circuito também assumirá o valor zero.
Ano: 2008
Banca:
CESPE / CEBRASPE
Órgão:
SEPLAG-DF
Prova:
CESPE - 2008 - SEPLAG-DF - Professor - Eletrônica |
Q161873
Engenharia Eletrônica
Texto associado
Tendo como base o circuito lógico mostrado na figura acima, e
considerando os sinais aplicados às entradas A e B, julgue os
itens que se seguem.
Tendo como base o circuito lógico mostrado na figura acima, e
considerando os sinais aplicados às entradas A e B, julgue os
itens que se seguem.
No intervalo considerado, o sinal Y apresenta mais pulsos na posição 1 que o sinal X.
Ano: 2008
Banca:
CESPE / CEBRASPE
Órgão:
SEPLAG-DF
Prova:
CESPE - 2008 - SEPLAG-DF - Professor - Eletrônica |
Q161872
Engenharia Eletrônica
Texto associado
Tendo como base o circuito lógico mostrado na figura acima, e
considerando os sinais aplicados às entradas A e B, julgue os
itens que se seguem.
Tendo como base o circuito lógico mostrado na figura acima, e
considerando os sinais aplicados às entradas A e B, julgue os
itens que se seguem.
O sinal de saída S assume a forma equivalente ao de B.
Ano: 2008
Banca:
CESPE / CEBRASPE
Órgão:
SEPLAG-DF
Prova:
CESPE - 2008 - SEPLAG-DF - Professor - Eletrônica |
Q161867
Engenharia Eletrônica
A respeito do circuito lógico acima, julgue o item a seguir.A expressão booleana resultante para a saída S é S=A.B.
Ano: 2008
Banca:
CESPE / CEBRASPE
Órgão:
HEMOBRÁS
Prova:
CESPE - 2008 - HEMOBRÁS - Especialista em Produção de Hemoderivados - Engenheiro Eletrônico |
Q153913
Engenharia Eletrônica
Texto associado
Considere que um microcontrolador de 8 bits apresente como características: 8 kilobytes de memória Flash, 512 bytes de memória EEPROM, 1 kilobyte de memória SRAM, 23 linhas de I/O programáveis, dois contatores/temporizadores de 8 bits; um contador/temporizador de 16 bits, ADC (conversor analógico/digital) de 10 bits com 6 canais, interface USART, interface SPI, interface I2C e temporizador watchdog (cão de guarda). A respeito desse microcontrolador julgue os itens subseqüentes.
O ADC de 10 bits corresponde a um conversor analógico/digital que gera uma palavra digital cujo valor pode variar de 0 a 1023.
Ano: 2008
Banca:
CESPE / CEBRASPE
Órgão:
HEMOBRÁS
Prova:
CESPE - 2008 - HEMOBRÁS - Especialista em Produção de Hemoderivados - Engenheiro Eletrônico |
Q153901
Engenharia Eletrônica
Texto associado
Considerando a tabela-verdade acima, que descreve o
comportamento de um circuito convencional com três
entradas e uma saída, e na qual X representa dont’care
(não importa), julgue os itens seguintes.
Considerando a tabela-verdade acima, que descreve o
comportamento de um circuito convencional com três
entradas e uma saída, e na qual X representa dont’care
(não importa), julgue os itens seguintes.
A função lógica indicada na tabela só pode ser implementada utilizando portas E (and) com três entradas.
Ano: 2008
Banca:
CESPE / CEBRASPE
Órgão:
HEMOBRÁS
Prova:
CESPE - 2008 - HEMOBRÁS - Especialista em Produção de Hemoderivados - Engenheiro Eletrônico |
Q153900
Engenharia Eletrônica
Texto associado
Considerando a tabela-verdade acima, que descreve o
comportamento de um circuito convencional com três
entradas e uma saída, e na qual X representa dont’care
(não importa), julgue os itens seguintes.
Considerando a tabela-verdade acima, que descreve o
comportamento de um circuito convencional com três
entradas e uma saída, e na qual X representa dont’care
(não importa), julgue os itens seguintes.
A função de saída f será sempre dependente da entrada B, mesmo na implementação com mínimo número de portas lógicas.
Ano: 2008
Banca:
CESPE / CEBRASPE
Órgão:
HEMOBRÁS
Prova:
CESPE - 2008 - HEMOBRÁS - Especialista em Produção de Hemoderivados - Engenheiro Eletrônico |
Q153899
Engenharia Eletrônica
Texto associado
Considerando a tabela-verdade acima, que descreve o
comportamento de um circuito convencional com três
entradas e uma saída, e na qual X representa dont’care
(não importa), julgue os itens seguintes.
Considerando a tabela-verdade acima, que descreve o
comportamento de um circuito convencional com três
entradas e uma saída, e na qual X representa dont’care
(não importa), julgue os itens seguintes.
O don’t care deve ser necessariamente considerado como tendo nível 1.
Ano: 2008
Banca:
CESPE / CEBRASPE
Órgão:
HEMOBRÁS
Prova:
CESPE - 2008 - HEMOBRÁS - Especialista em Produção de Hemoderivados - Engenheiro Eletrônico |
Q153898
Engenharia Eletrônica
Texto associado
Considerando a tabela-verdade acima, que descreve o
comportamento de um circuito convencional com três
entradas e uma saída, e na qual X representa dont’care
(não importa), julgue os itens seguintes.
Considerando a tabela-verdade acima, que descreve o
comportamento de um circuito convencional com três
entradas e uma saída, e na qual X representa dont’care
(não importa), julgue os itens seguintes.
A função de saída f pode não necessitar de um circuito de implementação, por poder ser exatamente igual a uma das entradas.
Ano: 2008
Banca:
CESPE / CEBRASPE
Órgão:
HEMOBRÁS
Prova:
CESPE - 2008 - HEMOBRÁS - Especialista em Produção de Hemoderivados - Engenheiro Eletrônico |
Q153897
Engenharia Eletrônica
Texto associado
Considerando a tabela-verdade acima, que descreve o
comportamento de um circuito convencional com três
entradas e uma saída, e na qual X representa dont’care
(não importa), julgue os itens seguintes.
Considerando a tabela-verdade acima, que descreve o
comportamento de um circuito convencional com três
entradas e uma saída, e na qual X representa dont’care
(não importa), julgue os itens seguintes.
Essa tabela só pode ser implementada por meio de um circuito digital seqüencial.
Ano: 2008
Banca:
CESPE / CEBRASPE
Órgão:
HEMOBRÁS
Prova:
CESPE - 2008 - HEMOBRÁS - Especialista em Produção de Hemoderivados - Engenheiro Eletrônico |
Q153896
Engenharia Eletrônica
Texto associado
Um encoder incremental possui dois sinais de saída, na forma de onda
quadrada, de mesma freqüência e defasados em ¼ de ciclo. Assumindo que
as saídas dos canais tenham ciclo de trabalho de 50%, existem duas
possibilidades para a temporização dos mesmos, conforme indicado por caso
A e caso B na figura acima. Os sinais do encoder incremental são
processados pelo circuito digital indicado na mesma figura. Acerca do
funcionamento desse circuito em regime permanente, e considerando que
todos os componentes do circuito são ideais, julgue os itens subseqüentes.
Um encoder incremental possui dois sinais de saída, na forma de onda
quadrada, de mesma freqüência e defasados em ¼ de ciclo. Assumindo que
as saídas dos canais tenham ciclo de trabalho de 50%, existem duas
possibilidades para a temporização dos mesmos, conforme indicado por caso
A e caso B na figura acima. Os sinais do encoder incremental são
processados pelo circuito digital indicado na mesma figura. Acerca do
funcionamento desse circuito em regime permanente, e considerando que
todos os componentes do circuito são ideais, julgue os itens subseqüentes.
Se as saídas do encoder incremental se comportarem como ilustrado no caso B, então a saída 
do Flip-flop do tipo D sempre estará em nível lógico baixo.
do Flip-flop do tipo D sempre estará em nível lógico baixo.
Ano: 2008
Banca:
CESPE / CEBRASPE
Órgão:
HEMOBRÁS
Prova:
CESPE - 2008 - HEMOBRÁS - Especialista em Produção de Hemoderivados - Engenheiro Eletrônico |
Q153895
Engenharia Eletrônica
Texto associado
Um encoder incremental possui dois sinais de saída, na forma de onda
quadrada, de mesma freqüência e defasados em ¼ de ciclo. Assumindo que
as saídas dos canais tenham ciclo de trabalho de 50%, existem duas
possibilidades para a temporização dos mesmos, conforme indicado por caso
A e caso B na figura acima. Os sinais do encoder incremental são
processados pelo circuito digital indicado na mesma figura. Acerca do
funcionamento desse circuito em regime permanente, e considerando que
todos os componentes do circuito são ideais, julgue os itens subseqüentes.
Um encoder incremental possui dois sinais de saída, na forma de onda
quadrada, de mesma freqüência e defasados em ¼ de ciclo. Assumindo que
as saídas dos canais tenham ciclo de trabalho de 50%, existem duas
possibilidades para a temporização dos mesmos, conforme indicado por caso
A e caso B na figura acima. Os sinais do encoder incremental são
processados pelo circuito digital indicado na mesma figura. Acerca do
funcionamento desse circuito em regime permanente, e considerando que
todos os componentes do circuito são ideais, julgue os itens subseqüentes.
Como a entrada CLR do flip-flop do tipo D é ativada por nível alto, e essa entrada está em nível baixo, então a saída 
sempre estará em nível alto.
sempre estará em nível alto.
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