Questões de Engenharia Eletrônica - Álgebra Booleana e Circuitos Lógicos em Engenharia Eletrônica para Concurso - Página 22

Q189678

Ano: 2010 Banca: CESGRANRIO Órgão: Petrobras Prova: CESGRANRIO - 2010 - Petrobras - Técnico de Telecomunicações Júnior |

Q189678 Engenharia Eletrônica

Em um processo industrial, o acionamento de uma determinada válvula, representada pela variável lógica V, está associado às condições de 3 (três) chaves representadas pelas variáveis C₁ , C₂ e C₃ . A válvula V, em sua operação normal, está sempre aberta (V=1). Ela somente será fechada (V=0) quando as condições lógicas das chaves C₁ C₂ C₃ estiverem, nesta ordem, iguais a 010 ou 011 ou 111.
A função booleana da válvula: V = f (C₁ , C₂ , C₃ ) é dada por

A

V = C₂ + C1 C₃

B

V = C₁ + C₁ C₃

C

V = C₁ C₂ + C₃

D

V= C₁ C₂ + C₁ C₃

E

V = C₁ C₂ + C C₃ + C₁ C₃

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Q189675

Ano: 2010 Banca: CESGRANRIO Órgão: Petrobras Prova: CESGRANRIO - 2010 - Petrobras - Técnico de Telecomunicações Júnior |

Q189675 Engenharia Eletrônica

Um circuito combinacional que apresenta três entradas lógicas, F, G e H, tem sua saída Y = FGH + FGH + FGH + FGH dada pela função

A expressão simplificada de Y é

A

FG + H

B

FG + H

C

FH

D

F

E

G

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Q189674

Ano: 2010 Banca: CESGRANRIO Órgão: Petrobras Prova: CESGRANRIO - 2010 - Petrobras - Técnico de Telecomunicações Júnior |

Q189674 Engenharia Eletrônica

Texto associado

Uma função booleana X=f (E,F,G,H) é representada pela sua configuração no mapa de Karnaugh da figura acima. A expressão mais simples dessa função é

A

FG + EF

B

EF + FG

C

EF + HG

D

EF + HG

E

EH + FG

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Q187366

Ano: 2011 Banca: CESGRANRIO Órgão: PETROQUÍMICA SUAPE Prova: CESGRANRIO - 2011 - PETROQUÍMICA SUAPE - Engenheiro de Manutenção Pleno - Elétrica |

Q187366 Engenharia Eletrônica

A tabela verdade, mostrada acima, representa a função lógica F = f(X,Y,Z) de um circuito digital. A expressão mínima de F é

A

B

C

D

E

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Q186440

Ano: 2011 Banca: CESGRANRIO Órgão: PETROQUÍMICA SUAPE Prova: CESGRANRIO - 2011 - PETROQUÍMICA SUAPE - Operador Pleno |

Q186440 Engenharia Eletrônica

O programa em Ladder acima aciona a bobina S, obedecendo às condições dos contatos A e B. A expressão lógica correspondente ao programa é

A

S = AB

B

C

S = A + B

D

E

S = A + B + M

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Q185195

Ano: 2010 Banca: CESGRANRIO Órgão: PETROQUÍMICA SUAPE Prova: CESGRANRIO - 2010 - PETROQUÍMICA SUAPE - Técnico de Instrumentação Júnior |

Q185195 Engenharia Eletrônica

Texto associado

Observando a tabela verdade, a porta lógica que o circuito apresentado representa é

A

OU.

B

NÃO OU.

C

E.

D

NÃO E.

E

INVERSORA.

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Q185193

Ano: 2010 Banca: CESGRANRIO Órgão: PETROQUÍMICA SUAPE Prova: CESGRANRIO - 2010 - PETROQUÍMICA SUAPE - Técnico de Instrumentação Júnior |

Q185193 Engenharia Eletrônica

Texto associado

No circuito lógico acima, a tabela verdade, que representa a relação entre as entradas A e B e a saída S, é a que se apresenta em

A

B

C

D

E

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Q185125

Ano: 2010 Banca: CESGRANRIO Órgão: PETROQUÍMICA SUAPE Prova: CESGRANRIO - 2010 - PETROQUÍMICA SUAPE - Engenheiro de Equipamento Pleno - Eletricidade |

Q185125 Engenharia Eletrônica

Imagem associada para resolução da questão

O circuito lógico combinacional mostrado na figura acima tem, como entradas, as variáveis lógicas X, Y e Z e, como saída, a variável F. A expressão simplificada da função booleana F é

A

F=XY

B

F=Y

C

F= YZ

D

F=

E

F=

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Q184707

Ano: 2010 Banca: CESPE / CEBRASPE Órgão: ABIN Prova: CESPE - 2010 - ABIN - Oficial Técnico de Inteligência – Área de Engenharia Elétrica |

Q184707 Engenharia Eletrônica

Texto associado

O circuito acima representa uma porta lógica digital
implementada com a tecnologia NMOS. Os transistores de
chaveamento (com entradas

) são idênticos e do tipo
enriquecimento, mas o transistor de carga é do tipo depleção. As
tensões de limiar dos transistores de chaveamento e carga são 1 V
e !3 V, respectivamente. Para esse circuito, o nível lógico alto (1
digital) é definido como qualquer tensão analógica compreendida
entre 3,5 V e 5 V, e o nível lógico baixo (0 digital) corresponde às
tensões analógicas entre 0 e 1,8 V. Esse circuito apresenta duas
peculiaridades:

I se pelo menos um dos transistores de chaveamento operar com
entrada em 5 V, a tensão de saída

não excederá 0,3 V;

II somente com ambas as entradas simultaneamente no nível
lógico baixo, a saída atinge o nível lógico alto.

Com base nessas informações, julgue os itens subsequentes.

O circuito desempenha a função de porta NAND (complemento da porta lógica E) de duas entradas.

Certo

Errado

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Q183127

Ano: 2011 Banca: CESGRANRIO Órgão: Petrobras Prova: CESGRANRIO - 2011 - Petrobras - Engenheiro de Equipamento Júnior - Eletrônica |

Q183127 Engenharia Eletrônica

Desconsiderando-se os inversores, a menor soma de produtos que implementa o mapa acima possui

A

3 portas AND de 2 entradas e 1 porta OR de 3 entradas.

B

3 portas AND de 3 entradas e 1 porta OR de 3 entradas.

C

2 portas AND de 2 entradas e 1 porta OR de 2 entradas.

D

2 portas AND de 2 entradas, 1 porta AND de 3 entradas e 1 porta OR de 3 entradas

E

1 porta AND de 2 entradas, 2 portas AND de 3 entradas e 1 porta OR de 3 entradas.

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Q183126

Ano: 2011 Banca: CESGRANRIO Órgão: Petrobras Prova: CESGRANRIO - 2011 - Petrobras - Engenheiro de Equipamento Júnior - Eletrônica |

Q183126 Engenharia Eletrônica

Deseja-se projetar um circuito, usando-se apenas um somador de 4 bits tipo 7483, que converta um número D₄D₃D₂D₁D₀ , em representação BCD de 5 bits (0 a 19), para um número B₄B₃B₂B₁B₀ em representação binária de 5 bits. Para isso, basta zerar Ci e tomar as saídas do somador, desde que as entradas A₃A₂A₁A₀e B₃B₂B₁B₀ sejam, respectivamente,

A

D₃D₂D₁D₀ e 1010

B

D₃D₂D₁D₀ e 0110

C

D₃D₂D₁D₀ e D₄0D₄0

D

D₃D₂D₁D₀ e 0D₄D₄0

E

D₃D₂D₁D₀e D₄D₄D₄D₄

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Q183125

Ano: 2011 Banca: CESGRANRIO Órgão: Petrobras Prova: CESGRANRIO - 2011 - Petrobras - Engenheiro de Equipamento Júnior - Eletrônica |

Q183125 Engenharia Eletrônica

Deseja-se comparar o número P₃P₂P₁P₀(com sinal – representado de –8 a +7) com o número Q₃Q₂Q₁Q₀(sem sinal – representado de 0 a 15), usando-se um comparador sem sinal tipo 7485. Para isso, basta zerar A > B_i e A < B_i, ativar A = B_ie tomar as saídas do comparador, desde que as entradas A₃A₂A₁A₀e B₃B₂B₁B₀sejam, respectivamente

A

0P₂P₁P₀ e Q₃Q₂Q₁Q₀

B

P₃P₂P₁P₀ e 1Q₂Q₁Q₀

C

0P₂P₁P₀ e 1Q₂Q₁Q₀

D

0P₂P₁P₀ e (P₃ + Q₃)Q₂Q₁Q₀

E

(P₃ + Q₃)P₂P₁P₀e 0Q₂Q₁Q₀

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Q182831

Ano: 2011 Banca: CESGRANRIO Órgão: Petrobras Prova: CESGRANRIO - 2011 - Petrobras - Técnico de Telecomunicações Júnior |

Q182831 Engenharia Eletrônica

Imagem associada para resolução da questão

Considere o circuito digital da figura acima. Sabendo-se queK=K₃K₂K₁K₀,P=P₃P₂P₁P₀ e Z=Z₃Z₂Z₁Z₀são números de 4 bits, a saída S da unidade aritmética é

A

Z + K – P

B

Z + K – P + 1

C

Z – K + P

D

Z – K + P + 1

E

Z – K + P – 1

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Q182830

Ano: 2011 Banca: CESGRANRIO Órgão: Petrobras Prova: CESGRANRIO - 2011 - Petrobras - Técnico de Telecomunicações Júnior |

Q182830 Engenharia Eletrônica

Em termos de produto de somas, a menor expressão que representa a função (A+B) Imagem associada para resolução da questão

(B+C) é

A

(A+B)

B

(A+B)(B+C)

C

D

E

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Q182828

Ano: 2011 Banca: CESGRANRIO Órgão: Petrobras Prova: CESGRANRIO - 2011 - Petrobras - Técnico de Telecomunicações Júnior |

Q182828 Engenharia Eletrônica

O número de mintermos (combinações dos sinais D, C, B e A) que ativam a função F(D,C,B,A) = (A+B)
Imagem associada para resolução da questão

é

A

4

B

7

C

8

D

9

E

12

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Q182827

Ano: 2011 Banca: CESGRANRIO Órgão: Petrobras Prova: CESGRANRIO - 2011 - Petrobras - Técnico de Telecomunicações Júnior |

Q182827 Engenharia Eletrônica

O circuito digital, mostrado na figura acima, representa um

A

somador de 3 bits com carry de saída.

B

medidor de paridade com apontador de erro.

C

medidor de paridade com inversão controlada.

D

multiplexador de 3 bits com chave de seleção.

E

decodificador de paridade com sinal de casamento.

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Q181896

Ano: 2011 Banca: FCC Órgão: INFRAERO Prova: FCC - 2011 - INFRAERO - Engenheiro Eletrônico |

Q181896 Engenharia Eletrônica

A expressão está corretamente simplificada em:

A

Z

B

X + Y . Z

C

X + Z

D

1

E

Y . Z

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Q181876

Ano: 2011 Banca: FCC Órgão: INFRAERO Prova: FCC - 2011 - INFRAERO - Engenheiro Eletrônico |

Q181876 Engenharia Eletrônica

Para implementar uma porta EXCLUSIVE-OR de duas entradas são necessárias e suficientes

A

5 portas OR de duas entradas e uma porta AND de três entradas.

B

3 portas NAND de duas entradas e uma porta NOT.

C

5 portas AND de duas entradas e duas portas NOT.

D

4 portas NOR de duas entradas.

E

5 portas NAND de duas entradas.

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Q180906

Ano: 2011 Banca: FCC Órgão: TRT - 23ª REGIÃO (MT) Prova: FCC - 2011 - TRT - 23ª REGIÃO (MT) - Analista Judiciário - Engenharia Elétrica |

Q180906 Engenharia Eletrônica

Texto associado

Estão corretamente apresentadas duas condições de entrada e seus respectivos níveis lógicos de saída em

A

X Y Z S X Y Z S
0 1 1 1 1 0 1 1

B

X Y Z S X Y Z S
1 1 0 1 0 0 0 1

C

X Y Z S X Y Z S
0 1 1 1 1 0 1 0

D

X Y Z S X Y Z S
1 0 0 1 0 0 0 1

E

X Y Z S X Y Z S
0 1 0 1 1 1 1 1

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Q161873

Ano: 2008 Banca: CESPE / CEBRASPE Órgão: SEPLAG-DF Prova: CESPE - 2008 - SEPLAG-DF - Professor - Eletrônica |

Q161873 Engenharia Eletrônica

Texto associado

Tendo como base o circuito lógico mostrado na figura acima, e
considerando os sinais aplicados às entradas A e B, julgue os
itens que se seguem.

No intervalo considerado, o sinal Y apresenta mais pulsos na posição 1 que o sinal X.

Certo

Errado

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Questões de Concurso Sobre álgebra booleana e circuitos lógicos em engenharia eletrônica em engenharia eletrônica

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